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(284)

Unified Diff: tests_lit/llvm2ice_tests/vector-cast.ll

Issue 2468133002: [SubZero] Fix code generation for vector type (Closed) Base URL: https://chromium.googlesource.com/native_client/pnacl-subzero.git@master
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Index: tests_lit/llvm2ice_tests/vector-cast.ll
diff --git a/tests_lit/llvm2ice_tests/vector-cast.ll b/tests_lit/llvm2ice_tests/vector-cast.ll
index a987d8cb0ba304974e1f306695c50db2b57056f2..a23a1cd8c3afffc4668b94f96de8ae7c0685431f 100644
--- a/tests_lit/llvm2ice_tests/vector-cast.ll
+++ b/tests_lit/llvm2ice_tests/vector-cast.ll
@@ -33,7 +33,8 @@ entry:
; X8632: pcmpgtb
; ARM32: vshl.s8
; ARM32-NEXT: vshr.s8
-; MIPS32: andi t2,a0,0xff
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; MIPS32: andi t2,t2,0x1
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; MIPS32: sra t2,t2,0x1f
@@ -41,7 +42,8 @@ entry:
; MIPS32: srl v0,v0,0x8
; MIPS32: sll v0,v0,0x8
; MIPS32: or t2,t2,v0
-; MIPS32: srl v0,a0,0x8
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+; MIPS32: srl v0,v0,0x8
; MIPS32: andi v0,v0,0xff
; MIPS32: andi v0,v0,0x1
; MIPS32: sll v0,v0,0x1f
@@ -52,7 +54,8 @@ entry:
; MIPS32: ori t3,t3,0xff
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; MIPS32: sll t2,t2,0x8
; MIPS32: srl t2,t2,0x8
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; MIPS32: sll v0,v0,0x1f
; MIPS32: sra v0,v0,0x1f
@@ -79,7 +83,8 @@ entry:
; MIPS32: srl v1,v1,0x8
; MIPS32: sll v1,v1,0x8
; MIPS32: or v0,v0,v1
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+; MIPS32: srl v1,v1,0x8
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; MIPS32: andi v1,v1,0x1
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@@ -90,7 +95,8 @@ entry:
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@@ -109,7 +115,8 @@ entry:
; MIPS32: sll v0,v0,0x8
; MIPS32: srl v0,v0,0x8
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+; MIPS32: andi v0,v0,0xff
; MIPS32: andi v0,v0,0x1
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@@ -117,7 +124,8 @@ entry:
; MIPS32: srl t0,t0,0x8
; MIPS32: sll t0,t0,0x8
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; MIPS32: sll v0,v0,0x8
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; MIPS32: andi v0,v0,0x1
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@@ -155,7 +165,8 @@ entry:
; MIPS32: srl t1,t1,0x8
; MIPS32: sll t1,t1,0x8
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+; MIPS32: srl v1,v1,0x8
; MIPS32: andi v1,v1,0xff
; MIPS32: andi v1,v1,0x1
; MIPS32: sll v1,v1,0x1f
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; MIPS32: ori t0,t0,0xff
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+; MIPS32: move v0,a3
+; MIPS32: srl v0,v0,0x10
; MIPS32: andi v0,v0,0xff
; MIPS32: andi v0,v0,0x1
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@@ -201,7 +213,8 @@ entry:
; MIPS32: move v1,zero
; MIPS32: move t0,zero
; MIPS32: move t1,zero
-; MIPS32: andi t2,a0,0xffff
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+; MIPS32: andi t2,t2,0xffff
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; MIPS32: sll t2,t2,0x1f
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@@ -217,7 +230,8 @@ entry:
; MIPS32: sll t2,t2,0x10
; MIPS32: srl t2,t2,0x10
; MIPS32: or a0,a0,t2
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+; MIPS32: move v0,a1
+; MIPS32: andi v0,v0,0xffff
; MIPS32: andi v0,v0,0x1
; MIPS32: sll v0,v0,0x1f
; MIPS32: sra v0,v0,0x1f
@@ -233,7 +247,8 @@ entry:
; MIPS32: sll v0,v0,0x10
; MIPS32: srl v0,v0,0x10
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+; MIPS32: andi v0,v0,0xffff
; MIPS32: andi v0,v0,0x1
; MIPS32: sll v0,v0,0x1f
; MIPS32: sra v0,v0,0x1f
@@ -249,7 +264,8 @@ entry:
; MIPS32: sll v0,v0,0x10
; MIPS32: srl v0,v0,0x10
; MIPS32: or a2,a2,v0
-; MIPS32: andi v0,a3,0xffff
+; MIPS32: move v0,a3
+; MIPS32: andi v0,v0,0xffff
; MIPS32: andi v0,v0,0x1
; MIPS32: sll v0,v0,0x1f
; MIPS32: sra v0,v0,0x1f
@@ -305,14 +321,16 @@ entry:
; X8632: pand
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; ARM32-NEXT: vand {{.*}}, [[S]]
-; MIPS32: andi t2,a0,0xff
+; MIPS32: move t2,a0
+; MIPS32: andi t2,t2,0xff
; MIPS32: andi t2,t2,0x1
; MIPS32: andi t2,t2,0x1
; MIPS32: andi t2,t2,0xff
; MIPS32: srl v0,v0,0x8
; MIPS32: sll v0,v0,0x8
; MIPS32: or t2,t2,v0
-; MIPS32: srl v0,a0,0x8
+; MIPS32: move v0,a0
+; MIPS32: srl v0,v0,0x8
; MIPS32: andi v0,v0,0xff
; MIPS32: andi v0,v0,0x1
; MIPS32: andi v0,v0,0x1
@@ -322,7 +340,8 @@ entry:
; MIPS32: ori t3,t3,0xff
; MIPS32: and t2,t2,t3
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; MIPS32: andi t2,t2,0x1
; MIPS32: andi t2,t2,0x1
@@ -339,14 +358,16 @@ entry:
; MIPS32: sll t2,t2,0x8
; MIPS32: srl t2,t2,0x8
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; MIPS32: andi v0,v0,0x1
; MIPS32: andi v0,v0,0x1
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; MIPS32: andi v1,v1,0x1
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; MIPS32: andi v0,v0,0x1
@@ -373,14 +395,16 @@ entry:
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; X8632: pand
; ARM32: vmov.i16 [[S:.*]], #1
; ARM32-NEXT: vand {{.*}}, [[S]]
-; MIPS32: andi t2,a0,0xffff
+; MIPS32: move t2,a0
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; MIPS32: andi t2,t2,0x1
; MIPS32: andi t2,t2,0xffff
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@@ -573,12 +608,14 @@ entry:
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; MIPS32: sll v0,v0,0x8
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+; MIPS32: srl v1,v1,0x8
; MIPS32: andi v1,v1,0xff
; MIPS32: andi v1,v1,0xff
; MIPS32: sll v1,v1,0x8
@@ -638,7 +681,8 @@ entry:
; MIPS32: ori t0,t0,0xff
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@@ -663,7 +707,8 @@ entry:
; X8632: pcmpeqw
; X8632: psubw
; X8632: pand
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; MIPS32: andi t2,t2,0xffff
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@@ -673,7 +718,8 @@ entry:
; MIPS32: sll t2,t2,0x10
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; MIPS32: or a0,a0,t2
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; MIPS32: andi v0,v0,0xffff
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@@ -683,7 +729,8 @@ entry:
; MIPS32: sll v0,v0,0x10
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; MIPS32: andi v0,v0,0xffff
; MIPS32: srl t0,t0,0x10
; MIPS32: sll t0,t0,0x10
@@ -693,7 +740,8 @@ entry:
; MIPS32: sll v0,v0,0x10
; MIPS32: srl v0,v0,0x10
; MIPS32: or a2,a2,v0
-; MIPS32: andi v0,a3,0xffff
+; MIPS32: move v0,a3
+; MIPS32: andi v0,v0,0xffff
; MIPS32: andi v0,v0,0xffff
; MIPS32: srl t1,t1,0x10
; MIPS32: sll t1,t1,0x10
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